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sine_tables [2022/04/29 18:39]
liuzhuo
sine_tables [2022/04/29 18:50] (当前版本)
liuzhuo
行 4: 行 4:
  
  
-<​code ​verilog>+<​code>​
 module sin_table(address,​sin);​ module sin_table(address,​sin);​
 output [11:0] sin; output [11:0] sin;
 input  [9:0]  address; input  [9:0]  address;
 reg    [11:0] sin; reg    [11:0] sin;
 +
        ​always @(address)        ​always @(address)
               begin               begin
行 1038: 行 1039:
                   endcase                   endcase
               end               end
 +
 endmodule endmodule
  
 </​code>​ </​code>​