差别
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stepmxo2-lab4 [2018/08/28 15:32] group001 创建 |
stepmxo2-lab4 [2018/08/28 16:55] (当前版本) group001 [Verilog HDL建模描述] |
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行 17: | 行 17: | ||
=====Verilog HDL建模描述===== | =====Verilog HDL建模描述===== | ||
1位二进制比较器程序清单comparer1.v\\ | 1位二进制比较器程序清单comparer1.v\\ | ||
+ | <code verilog> | ||
+ | |||
+ | |||
module comparer1 | module comparer1 | ||
( | ( | ||
行 29: | 行 32: | ||
assign led3 = a&(!b); //a>b | assign led3 = a&(!b); //a>b | ||
endmodule | endmodule | ||
+ | </code> | ||
+ | | ||
=====实验步骤===== | =====实验步骤===== | ||
- 打开Lattice Diamond,建立工程。 | - 打开Lattice Diamond,建立工程。 |