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and_gate [2021/09/11 18:54] gongyusu |
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| - | ## 与门（AND Gate） | ||
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| - | 顾名思义，一个与门如果其所有的输入端都为高电平的时候，其输出为高电平。图1 为2输入与门的符号，表1 为与门的真值表。 | ||
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| - | {{drawio>andgatesymbol.png}}<WRAP centeralign>图1 一个与门</WRAP> | ||
| - | {{drawio>andgatetruetable.png}}<WRAP centeralign>表1 一个与门的真值表</WRAP> | ||
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| - | - [[https://www.electronicshub.org/digital-logic-and-gate/|逻辑与门]] | ||