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硬禾实战营verilog代码规范 [2020/01/17 08:49] gongyu |
硬禾实战营verilog代码规范 [2020/01/17 08:50] (当前版本) gongyu [2.模板示例] |
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行 212: | 行 212: | ||
\\ f.不能用 ”reg”,作为最后的后缀名,因为综合工具会给寄存器自动加上_reg, 如果命名里就用_reg作为后缀名则扰乱了网表的可读性。 | \\ f.不能用 ”reg”,作为最后的后缀名,因为综合工具会给寄存器自动加上_reg, 如果命名里就用_reg作为后缀名则扰乱了网表的可读性。 | ||
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### 2.模板示例 | ### 2.模板示例 | ||
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<code verilog> | <code verilog> | ||
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