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EPM240

EPM240
基本信息
描述:JTAG接口和系统内可编程性

MAX®II系列即时接通,非易失性CPLD基于0.18μm,6层金属闪光工艺,密度为240至2,210个逻辑单元(LE)(128至2,210个等效宏单元)和8千位的非易失性存储。 MAX II器件与其他CPLD相比,可提供高I / O数,快速性能和可靠的拟合架构。 具有MultiVolt核心,用户闪存(UFM)块,以及增强的系统内可编程性(ISP),MAX II器件旨在减少成本和功耗,同时为总线等应用提供可编程解决方案桥接,I / O扩展,上电复位(POR)和排序控制以及器件配置控制。

器件类别:可编程逻辑器件
产品图片
产品结构框图
产品特性

+ 低成本,低功耗CPLD + 即时启动,非易失性架构 + 待机电流低至25μA + 提供快速传播延迟和时钟到输出时间 + 提供四个全局时钟,每个逻辑阵列块(LAB)有两个时钟可用 + UFM可阻止高达8 Kbits的非易失性存储 + MultiVolt内核可为设备提供外部电源电压 + 3.3 V / 2.5 V或1.8 V + MultiVolt I / O接口,支持3.3V,2.5V,1.8V和1.5V逻辑电平 + 总线友好型架构,包括可编程摆率,驱动强度, + 总线保持和可编程上拉电阻 + 施密特触发启用噪声容限输入(每个引脚可编程) + I / O完全符合外围组件互连特殊要求 + 兴趣小组(PCI SIG)PCI本地总线规范,修订版2.2 for 3.3-V + 以66 MHz的频率运行 + 支持热插拔 + 内置联合测试行动组(JTAG)边界扫描测试(BST)电路 + 符合IEEE标准。 1149.1-1990 + 符合IEEE标准的ISP电路。 1532

设计工具
库/模型
CAD库文件
Electronic Component库文件
CPLD, MAX II
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IC CPLD FLASH 192 MACROCELL
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CPLD - Complex Programmable Logic Devices CPLD - MAX II 192 Macro 80 IOs
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EPM240T100C3N
CPLD - Complex Programmable Logic Devices CPLD - MAX II 192 Macro 80 IOs
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CPLD - Complex Programmable Logic Devices CPLD - MAX II 192 Macro 80 IOs
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Ultralibrian库文件
High efficiency, wide input compatible power supply module
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CPLD MAX® II Family 192 Macro Cells 123.5MHz 0.18um Technology 1.8V 68-Pin Micro FBGA Tray
CPLD MAX® II Family 192 Macro Cells 201.1MHz 0.18um Technology 2.5V/3.3V 100-Pin Micro FBGA Tray
CPLD MAX® II Family 192 Macro Cells 201.1MHz 0.18um Technology 1.8V 100-Pin TFBGA Tray
SnapEDA库文件
CPLD MAX II Family 192 Macro Cells 201.1MHz 0.18um Technology 2.5V/3.3V 100-Pin TQFP
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CPLD MAX II Family 192 Macro Cells 304MHz 0.18um Technology 1.8V 100-Pin TQFP
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Ic Max Ii Cpld 240 Le 100-Tqfp - Epm240t100c3
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CPLD MAX II Family 192 Macro Cells 304MHz 0.18um Technology 2.5V/3.3V 100-Pin TQFP
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Lucia li
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2019-08-30