以前,我打算直接转到与这个项目的总线接口。但是,这样做也会限制主机回读采样数据的速度。所以。。。我正在采取一种新的方法:我将在设计这个系统时考虑到常规的GPIOs,此时,通过高引脚数微控制器。一旦设计了一个板,它可以连接到一个子板,然后削减针计数到所需的总线。对于 8051 型总线,这只能是一些 D 锁和一些网络电阻器来完成的。
Sn74lvc1g123 - 可能只是处理我们的单次拍摄...就个人而言, 使用 Rc 计时的想法不太适合我, 对于这个项目来说, 其采样率在很大程度上是可变的...但是, 也许 som 'n 可以完成那些 R 和 C 输入与 SDRAM 时钟之类的东西。或者,即使 R 和 C 固定了一些其他路径(例如,在 10ns 时,最大采样为 100MS/s),只要我们能够确保 10ns 脉冲满足指令负载时钟边缘的设置/保持时间(当采样速率较低时)。